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Internal Block Diagram
UVLO
6
V B
V DD
9
NOISE
CANCELLER
R
S
R
Q
7
HO
HIN
10
SCHMITT
TRIGGER INPUT
HS(ON/OFF)
5
V S
LIN
12
UVLO
3
V CC
SD
11
CYCLE-By-CYCLE
EDGE TRIGGERED
SHUTDOWN
LS(ON/OFF)
VSS/COM
LEVEL
SHIFT
DELAY
1
LO
V SS
13
2
COM
Pin 4, 8, and 14 are no connection
Figure 3. Functional Block Diagram (Referenced 14-Pin)
UVLO
7
V B
V DD
11
NOISE
CANCELLER
R
S
R
Q
8
HO
HIN
12
SCHMITT
TRIGGER INPUT
HS(ON/OFF)
6
V S
LIN
14
UVLO
3
V CC
SD
13
CYCLE-By-CYCLE
EDGE TRIGGERED
SHUTDOWN
LS(ON/OFF)
VSS/COM
LEVEL
SHIFT
DELAY
1
LO
V SS
15
2
COM
Pin 4, 5, 9,10 and 16 are no connection
Figure 4. Functional Block Diagram (Referenced 16-SOP)
? 2009 Fairchild Semiconductor Corporation
FAN7392 Rev. 1.0.4
3
www.fairchildsemi.com
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